Cantitate/Preț
Produs
Total produse
Vezi coșul
Verilog Coding for Logic Synthesis de Weng Fook Lee

Verilog Coding for Logic Synthesis

Autor Weng Fook Lee
en Limba Engleză Hardback – 17 apr 2003
Provides a practical approach to Verilog design and problem solving. * Bulk of the book deals with practical design problems that design engineers solve on a daily basis. * Includes over 90 design examples. * There are 3 full scale design examples that include specification, architectural definition, micro-architectural definition, RTL coding, testbench coding and verification. * Book is suitable for use as a textbook in EE departments that have VLSI courses
Citește tot Restrânge

Preț: 92153 lei

Preț vechi: 101268 lei
-9%

Puncte Express: 1382

Carte tipărită la comandă

Livrare economică 16-30 iulie

Livrare prin curier în România Termenul estimat este afișat lângă disponibilitate.
Transport gratuit pentru acest produs Plată online sau ramburs, în funcție de opțiunile comenzii.
Retur gratuit în 14 zile Comandă securizată și suport în română.
 Adaugă în coș

Wish list
Gift list
Am citit!
Adaugă în listă

Specificații

ISBN-13: 9780471429760
ISBN-10: 0471429767
Pagini: 336
Dimensiuni: 161 x 240 x 23 mm
Greutate: 0.67 kg
Ediția:New.
Editura: Wiley
Locul publicării:Hoboken, United States

Public țintă

VLSI Design Engineers and Seniors and Graduate Students

Descriere

Verilog is a Hardware Description Language (HDL) used to design and document electronic systems. Verilog HDL allows designers to virtually design systems without expending time or resources on physical models. It is the most widely used HDL with a user community of more than 50,000 active designers.